1. TEDE PUCRS
  2. Teses e Dissertações dos Programas de Pós-Graduação da PUCRS
  3. Programa de Pós-Graduação em Ciência da Computação
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dc.creatorStefani, Marco Pokorski-
dc.creator.Latteshttp://lattes.cnpq.br/1488636349360928por
dc.contributor.advisor1Marcon, César Augusto Missio-
dc.contributor.advisor1Latteshttp://lattes.cnpq.br/8611020242763828por
dc.contributor.advisor-co1Silveira, Jarbas Aryel Nunes da-
dc.contributor.advisor-co1Latteshttp://lattes.cnpq.br/0406937598151848por
dc.date.accessioned2024-10-22T19:37:46Z-
dc.date.issued2023-08-24-
dc.identifier.urihttps://tede2.pucrs.br/tede2/handle/tede/11400-
dc.description.resumoMemory errors can cause failures, security vulnerabilities, corruption, and data loss, which are unacceptable for server systems. These problems push the construction of a robust computing memory architecture design. Memory controllers can mitigate these errors by employing an Error Correction Code (ECC) in the data write and read flows. Environmental and technological factors imply different error probabilities, preventing defining at design time which ECC is most effective and efficient to be used. This work proposes a fault-tolerant mechanism acting as a memory controller encoding and decoding manager. This mechanism dynamically defines the ECC for each memory block, following as criteria the error rate captured at runtime and the ECCs efficacy implemented in the controller. Memory blocks with a high error rate can be recoded to a high efficacy ECC and vice versa. Experimental results show that our proposal achieves high error correction efficacy with high energy efficiency. Additionally, we developed the Absimth tool to analyze the efficacy and efficiency of the proposal that employs dynamic fault tolerance management mechanisms. Absimth enables hardware/software modeling and verification in various granularity levels, from in-memory applications to the operating system, including encoding and decoding processes that employ ECCs, enabling comparing the efficacy and efficiency of the proposed solutions in uncountable scenariospor
dc.description.abstractErros de memória podem causar falhas, vulnerabilidades de segurança, corrupção e perda de dados que são inaceitáveis para servidores. Esses problemas impulsionam a construção de um projeto de arquitetura de memória robusta. As controladoras de memória podem atenuar esses erros empregando um Código de Correção de Erro (ECC) nos fluxos de gravação e leitura de dados. Fatores ambientais e tecnológicos implicam diferentes probabilidades de erro, impedindo definir em tempo de projeto qual ECC é mais eficaz e eficiente a ser utilizado. Este trabalho propõe um mecanismo tolerante a falhas atuando como gerenciador de codificação e decodificação da controladora de memória. Este mecanismo define dinamicamente o ECC para cada bloco de memória, seguindo como critério a taxa de erro capturada em tempo de execução e a eficácia dos ECCs implementados na controladora. Blocos de memória com uma alta taxa de erro podem ser recodificados para um ECC de alta eficácia e vice-versa. Resultados experimentais mostram que nossa proposta alcança elevada eficácia na correção de erros com alta eficiência energética. Adicionalmente, desenvolvemos a ferramenta Absimth para analisar a eficácia e eficiência da proposta que emprega mecanismos de gerenciamento dinâmico de tolerância a falhas. A ferramenta Absimth permite a modelagem e verificação de hardware/software em diversas granularidades, desde aplicativos armazenados na memória até o sistema operacional, incluindo processos de codificação e decodificação de diversos ECCs, habilitando comparar a eficácia e eficiência das soluções propostas em inúmeros cenários.por
dc.description.provenanceSubmitted by PPG Ciência da Computação ([email protected]) on 2024-10-01T19:40:03Z No. of bitstreams: 1 MARCO_POKORSKI_STEFANI_TES.pdf: 6612069 bytes, checksum: f34b3d7760fd3817e410a3a31f5d87cf (MD5)eng
dc.description.provenanceApproved for entry into archive by Sarajane Pan ([email protected]) on 2024-10-22T19:22:36Z (GMT) No. of bitstreams: 1 MARCO_POKORSKI_STEFANI_TES.pdf: 6612069 bytes, checksum: f34b3d7760fd3817e410a3a31f5d87cf (MD5)eng
dc.description.provenanceMade available in DSpace on 2024-10-22T19:37:46Z (GMT). No. of bitstreams: 1 MARCO_POKORSKI_STEFANI_TES.pdf: 6612069 bytes, checksum: f34b3d7760fd3817e410a3a31f5d87cf (MD5) Previous issue date: 2023-08-24eng
dc.formatapplication/pdf*
dc.thumbnail.urlhttps://tede2.pucrs.br/tede2/retrieve/191961/MARCO_POKORSKI_STEFANI_TES.pdf.jpg*
dc.languageengpor
dc.publisherPontifícia Universidade Católica do Rio Grande do Sulpor
dc.publisher.departmentEscola Politécnicapor
dc.publisher.countryBrasilpor
dc.publisher.initialsPUCRSpor
dc.publisher.programPrograma de Pós-Graduação em Ciência da Computaçãopor
dc.rightsAcesso Abertopor
dc.subjectTolerância a Falhaspor
dc.subjectMemória Confiávelpor
dc.subjectCódigo de Correção de Erro (ECC)por
dc.subjectECC Dinâmicopor
dc.subjectControlador de Memóriapor
dc.subjectFault Toleranceeng
dc.subjectReliable Memoryeng
dc.subjectError Correting Code (ECC)eng
dc.subjectDynamic ECCeng
dc.subjectMemory Controllereng
dc.subject.cnpqCIENCIA DA COMPUTACAO: TEORIA DA COMPUTACAOpor
dc.titleDynamic fault tolerant mechanism for memory controllerspor
dc.title.alternativeMecanismo dinâmico de tolerância a falhas para controladoras de memóriapor
dc.typeTesepor
dc.restricao.situacaoTrabalho não apresenta restrição para publicaçãopor
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