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Data de defesaPré-visualizaçãoTítuloAutorOrientadorProgramaTipo de documento
31-Out-2007402108.pdf.jpgModelagem e validação de redes intrachip através de síntese comportamentalDisconzi, Rosana PerazzoloCalazans, Ney Laert VilarPrograma de Pós-Graduação em Ciência da ComputaçãoDissertação
29-Ago-2012467157.pdf.jpgProposta de uma infraestrutura de geração e avaliação para redes intrachip Hermes-GSchemmer, Raffael BottoliCalazans, Ney Laert VilarPrograma de Pós-Graduação em Ciência da ComputaçãoDissertação
27-Ago-2012445336.pdf.jpgUm MPSOC GALS baseado em rede intrachip com geração local de relógioHeck, GuilhermeCalazans, Ney Laert VilarPrograma de Pós-Graduação em Ciência da ComputaçãoDissertação
28-Ago-2012444177.pdf.jpgSoft error mitigation in asynchronous networks on chipPontes, Julian José HilgembergCalazans, Ney Laert VilarPrograma de Pós-Graduação em Ciência da ComputaçãoTese
13-Abr-2012439051.pdf.jpgContributions to the design and prototyping of GALS and asynchronous systemsMoreira, Matheus TrevisanCalazans, Ney Laert VilarPrograma de Pós-Graduação em Ciência da ComputaçãoDissertação
7-Ago-2009421786.pdf.jpgVerificação e prototipação de redes intrachip : o estudo de caso Hermes-TBBezerra, Jeronimo CunhaCalazans, Ney Laert VilarPrograma de Pós-Graduação em Ciência da ComputaçãoDissertação
27-Jan-2010426062.pdf.jpgMapeamento e adaptação de rotas de comunicação em redes em chipMoreno, Edson IfarraguirreCalazans, Ney Laert VilarPrograma de Pós-Graduação em Ciência da ComputaçãoTese
19-Fev-2008408676.pdf.jpgProjeto e prototipação de interfaces e redes intrachip não-síncronas em FGPAsPontes, Julian José HilgembergCalazans, Ney Laert VilarPrograma de Pós-Graduação em Ciência da ComputaçãoDissertação
14-Jan-2016TES_MATHEUS_TREVISAN_MOREIRA_COMPLETO.pdf.jpgAsynchronous circuits : innovations in components, cell libraries and design templatesMoreira, Matheus TrevisanCalazans, Ney Laert VilarPrograma de Pós-Graduação em Ciência da ComputaçãoTese

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